2007级本科生黄玉娇
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毕业去向：2020 - 自今，FPGA设计工程师III ； 2019，FPGA设计工程师II-高级； 2017，FPGA设计工程师II，圣克拉拉，加州； 2017，研发工程师，加州大学伯克利分校，伯克利，加州； 2014-2016，FPGA开发工程师，ABB, 图尔吉，瑞士； 2014，苏黎世联邦理工学院，FPGA研究工程师； 2013，苏黎世联邦理工学院，访问学生研究员； 2011-2013，中国科学院长春分院，理学硕士
所学专业：生物医学工程
研究方向：掌握数字设计、计算机体系结构、嵌入式系统、信号处理；熟悉VHDL、Verilog、SystemVerilog、C、Python、Makefile、Tcl、Matlab、汇编。
介绍：有7年以上FPGA设计、RTL开发、仿真、验证和开发方面的专业经验； 对时钟域交叉、布局规划和时序关闭概念有深入的了解； 具有主动、快速的学习能力和解决问题的能力，以及很强的沟通和人际交往能力； 曾在美国、欧洲和亚洲工作，能够跨文化和动态团队进行协作。
学历：硕士研究生
学位：硕士学位
状态：毕业
电子邮箱：huangyujiao21@gmail.com